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ISE中如何跨时钟域分析

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ISE中的IP核用于FPGA 。如何模拟ISE中Coregenerator生成的FIFO在库文件中有描述 ， 的 ， v文件只是一个仿真用的黑盒，说明有这么一个东西，在编译仿真的时候会在库中加载描述的函数 ， ngc是一个用于实现的网表文件，它在实现时与其他网表一起使用 。

1、在ise中,当编写好某一元件的代码后,怎么生成原理图 checksyntax优先 。通过后 ， 没问题就可以合成尺寸了 ， 然后就可以看到rtl级别的示意图了 。在左侧的进程框中，单击合成中的VIEWRTLschematic 。如果想从这个编译好的模块生成一个原始的原理图，只需点击designUtilities下的CreateSchematicSymbol，它就会成为原理图的一个小组件 。放在原理图上双击，可以看到原文中的原理图结构 。

2、如何在ise中查看已经综合好的电路的时间(速度设计概要窗口中的设计概述(概要和静态时序)“设计概要”窗口中的详细报告提供了详细信息 。请注意 ， 默认情况下不会生成某些详细报告 。如果您想看到它们，您需要打开implementationproperties中的选项 。

3、FPGA中用了 ISE中IP核,一个单口ram,但只有一个wea写使能端,想问下,如...我用的是Altera，不过原理应该是一样的 。Altera的单端口RAm使能了wren 。如果为1 ， 则表示正在写入ram，如果为0，则表示正在读取ram 。也就是说，要么读，要么写 ， 不写的时候学习 。只要不改变地址，输出值保持不变，不会对系统产生影响 。所以，一般来说，不写，就读RAM 。单口RAM中的wea信号线只用于控制写使能(即在clk上升沿检测到wea1时，会根据输入数据dina写入addra对应的地址块，如果wea0 ， 则不会写入内存)；

4、ise中工具栏中的选项如何拖到桌面按住shift键，用鼠标右键单击 。将ise中工具栏的选项拖动到桌面的方法如下:首先找到ise，点击工作栏；其次 ， 按住shift键，用鼠标右键点击选项；最后，释放shift键并将其拖至桌面 。工具栏是与IE浏览器捆绑的网络辅助软件，帮助用户快速访问网站，并提供特定功能 。
5、如何在 ISE中仿真Coregenerator生成的FIFO【ISE中如何跨时钟域分析】真实函数在库文件中有描述 。的，v文件只是一个黑盒，用于仿真，表示有这么一个东西，在编译仿真的时候会在库中加载所描述的函数 。ngc是一个用于实现的网表文件，在实现时与其他网表文件结合在一起 ， 这些都是工具软件自动完成的，只需点击按钮即可 。如果是第三方软件 ， 可能需要在仿真时编译库文件 。

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